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基于FPGA的奇偶分频器的设计与实现范本模板 (2).docx
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。基于FPGA的奇偶分频器的设计与实现范本模板 (2).docx
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内蒙古科技大学
本科生毕业设计说明书(毕业论文)
题
目:基于 FPGA 的奇偶分频器的设
计与实现
学生姓名:
学
专
班
号:
业:电子信息工程
级:电信 10 —1 班
指导教师:
内蒙古科技大学毕业设计说明书(毕业论文)
基于 FPGA 的奇偶分频器的设计与实现
摘 要
分频器作为一种最基本的数字电路,广泛的应用在各种复杂的逻辑电路设计中,对于
FPGA 芯片来说,虽然能用自带的锁相环来产生一部分我们所需的频率,但是,用VHDL
语言实现分频能从同一时钟较为方便、快捷的生成多个所需要的频率,同时能够实现信
号的同步,因此,分频器的应用非常广泛。
本设计应用软件为开发平台,运用 VHDL 语言编程实现整数的奇偶分频的设计,在
本设计中实现了 0、2、4、6、8、10、12、14 偶数的整数分频器设计和 1、3、5、7、9、
11、13、15 奇数的整数分频器设计。通过仿真结果,验证了设计的正确性.
关键词:FPGA;分频器;VHDL 语言;Quartus Ⅱ
I
内蒙古科技大学毕业设计说明书(毕业论文)
Design and implementation of FPGA-based parity divider
Abstract
Divider as a basic digital circuits, widely used in a variety of complex logic circuit design,
the FPGA chip, although able to own a part of our phase-locked loop to produce the desired
frequency, but using VHDL language divide from the same clock frequency is more
convenient and efficient to generate multiple needs , while able to achieve synchronization
signal, and therefore, the divider is widely used.
The design of application software development platform , the use of VHDL language
programming odd integer divider design, the design is implemented in an even integer
divider 0,2,4,6,8,10,12,14 design and 1,3,5,7,9,11,13,15 odd integer divider design。
The simulation results verify the correctness of the design.
Key words: FPGA; divider; VHDL language;Quartus Ⅱ
II
内蒙古科技大学毕业设计说明书(毕业论文)
目 录
摘 要.........................................................................................................................................I
Abstract ......................................................................................................................................II
第一章 绪论.............................................................................................................................. 1
1.1 课题来源 ..................................................................................................................... 1
1。2 选题的意义和目的 .................................................................................................. 2
1。3 课题研究现状 .......................................................................................................... 3
1.4 本文组织结构 ............................................................................................................. 4
第二章 EDA 技术..................................................................................................................... 6
2.1 FPGA 技术................................................................................................................... 6
2.2 Quartus Ⅱ软件简介 ................................................................................................... 7
2。3 VHDL 语言 ............................................................................................................... 8
2。3。1 VHDL 简介 ................................................................................................. 8
2.3。2 VHDL 特点 .................................................................................................... 9
2。3。3 VHDL 组成 ............................................................................................... 10
第三章 奇偶分频器设计与仿真 ............................................................................................ 12
3。1 偶数分频 ................................................................................................................ 12
3.1。1 原理分析 ..................................................................................................... 12
3.1。2 设计与仿真 ................................................................................................. 12
3.2 奇数分频 ................................................................................................................... 17
3。2。1 原理分析 .................................................................................................. 17
3.2。2 设计与仿真 ................................................................................................. 18
III
内蒙古科技大学毕业设计说明书(毕业论文)
第四章 系统设计 .................................................................................................................... 23
4.1 设计的任务 ............................................................................................................... 23
4。2 系统设计 ................................................................................................................ 23
4。3 其余模块设计 ........................................................................................................ 27
4。3。1 encoder_12 模块........................................................................................ 27
4.3。2 mux21 模块 .................................................................................................. 29
4.3。3 数码管显示驱动模块 ................................................................................. 30
第五章 下载与测试 ................................................................................................................ 35
5.1 BTYG-EDA 实验概述............................................................................................... 35
5。2 BTYG-EDA 实验开发系统特点............................................................................ 35
5。3 引脚分配 ................................................................................................................ 35
5。4 验证........................................................................................................................ 36
第六章 结论与展望 ................................................................................................................ 37
6。1 结论........................................................................................................................ 37
6。2 展望........................................................................................................................ 37
参考文献.................................................................................................................................. 39
致谢.......................................................................................................................................... 40
IV
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